[예제1]ORCAD 회로도작성, PCB설계

[예제1]ORCAD 회로도작성, PCB설계

실습예제1 입니다. 아래의 회로도를 작성합니다. 라이브러리를 제작하기 위해서 데이타 시트를 참고합니다. R1005 3D 파일 R1608 3D 파일 C1005 3D 파일 22-03-5045 3D파일

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  • · 2019. 9. 9.
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[Allegro PCB] Timing Vision Benefits 기능 활용

[Allegro PCB] Timing Vision Benefits 기능 활용

PCB설계시 기능적인 작업 시간은 줄여야 합니다. 작업시간을 매우 줄일 수 있는 기능중 하나를 소개합니다. 1. Constrant manager에서 Timing rule 설정 2. Timing Vision 기능으로 배선상태확인 1) Green is good 2) Red is short 3) Yellow is ling

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  • · 2019. 6. 6.
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Cadence Allegro orcad 17.2 설치 가이드

안녕하세요. 휴민스 이동호입니다. cadence allegro orcad 설치가이드 입니다. 아래는 제품의 설치 가이드입니다. 아래는 라이센스메니저 설치가이드입니다. 다른 캐드 프로그램과 동시에 설치시 충돌이 발생할수 있습니다.관련 문제 발생시 해당 엔지니어의 도움을 받으시면 됩니다. 감사합니다.

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  • · 2019. 1. 18.
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Capture 17.2 PDF Export 방법 및 주의사항

Capture 17.2 PDF Export 방법 및 주의사항

안녕하세요. 오늘은 고객사의 문의사항을 해결한 부분을 정리하고자합니다.고객사에서 오아캐드캡쳐를 사용하고 계십니다. PDF 추출을 하고 싶다고 하시어 Orcad Capture 17.2 버젼에서 PDF를 만드는 두가지 방법을 알려드렸습니다. 1. 출력일반적인 PDF 출력기법을 이용합니다.이 출력시에도 주의 해야할 사항은 Microsoft PDF로 사용할경우입니다. orcadps_17.2를 바로 사용하면 안될때가 있습니다.가능하면 별도의 PDF 사용하시면 됩니다. 2. 추출입니다.속성을 대부분 가지고 PDF 형태로 변환합니다.다른 툴에 비해서 준비 과정이 필요합니다. 나인플러스IT 에서 제공한 자료를 참고하시기 바랍니다. 그리고, 주의 하실 사항은 한글을 쓰시면 안됩니다.고객사 소장님께서 여러 테스트를 해 보..

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  • · 2019. 1. 17.
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Minimum Blind/Buried gab Error 해결하기

안녕하세요. 휴민스 입니다.이번시간에는 Allegro 에서 빌드업으로 설계중에 일어날수 있는 DRC 에러를 해결하는 방법을 설명합니다.빌드업은 층간 비아를 사용하게 되는데 서로 다른 층간 비아도 같은 층으로 생각하여 Space 룰을 체크하게 됩니다.이때발생하는 에러가 Minimum Blind/Buried gab error입니다. [해결방법]You might need to set the BBVIA_SEPARATION, Drawing level property, Edit>Properties, set the Find drop-down to Drawing and More to get to the properties. By default "infinite" layers are considered for BB Vi..

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  • · 2017. 10. 2.
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Array Resistor Xnet 설정방벙

안녕하세요. 전자캐드 연구실 휴민스 입니다.이번에는 알레그로(Orcad, Allegro)에서 Array 저항에 Xnet을 설정하는 방법을 익혀 보겠습니다.Xnet은 간단하게 클릭클릭 만으로 설정이 가능합니다.단, stub 저항이나 커패시터가 있다면 좀 더 고려 해야할 부분입니다. 첨부의 문서를 참고합니다.http://www.flowcad.ch/cms/upload/ApplicationNotes/xnets_rpacks.pdf 이름을 33옴으로 변경하여 사용

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  • · 2017. 5. 20.
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